Sortie d'usage universel de transistors de NPN la double verrouille 3-State 74AHCT595BQ, 115
diode rectifier circuit
,bridge rectifier circuit
CARACTÉRISTIQUES
• Protection d'ESD :
HBM EIA/JESD22-A114-A dépasse 2000 V
Le millimètre EIA/JESD22-A115-A dépasse 200 V
CDM EIA/JESD22-C101 dépasse 1000 V
• Retards de propagation équilibrés
• Toutes les entrées ont des actions de Schmitt-déclencheur
• Les entrées acceptent des tensions plus haut que VCC
• Pour AHC seulement : fonctionne avec des niveaux saisie de CMOS
• Pour AHCT seulement : fonctionne avec des niveaux saisie de TTL
• Spécifique de −40 au °C +85 et de from−40 à +125 APPLICATIONS de °C.
• conversion de données Périodique-à-parallèle
• Registre se tenant à télécommande.
DESCRIPTION
Les 74AHC/AHCT595 sont les dispositifs ultra-rapides de la SI-porte CMOS et sont goupille compatible avec la puissance faible Schottky TTL (LSTTL). Ils sont spécifiés conformément à no. standard 7A de JEDEC. Le 74AHC/AHCT595 est un registre à décalage périodique de 8 étapes avec un registre de stockage et 3 sorties d'état. Le registre à décalage a les horloges distinctes. Des données sont décalées sur les transitions positif-allantes de l'entrée de SHCP. Les données dans chaque registre sont transférées au registre de stockage sur une transition positif-allante de l'entrée de STCP. Si les deux horloges sont reliées ensemble, le registre à décalage sera toujours une impulsion d'horloge en avant du registre de stockage. Le registre à décalage a une entrée périodique (DS) et un résultat standard périodique (Q7) pour cascader. On lui donne également en remise asynchrone (le BAS actif) pour chacune des 8 étapes de registre à décalage. Le registre de stockage a 8 3 sorties parallèles de chauffeur de bus d'état. Les données dans le registre de stockage sont évident à la sortie toutes les fois que la sortie permettent l'entrée (OE) est BASSE.
à 8 bits périodique-dans/registre à décalage périodique ou parallèle- avec des verrous de sortie ; état 3
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