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Puce M24M01-RMN6TP de circuit intégré d'EEPROM de bus IC série de 1 Mbit

fabricant:
Produit de fabrication
Description:
Circuit intégré de mémoire EEPROM 1Mbit I²C 1 MHz 500 ns 8-SOIC
Catégorie:
Puce d'IC de mémoire instantanée
Prix:
Negotiation
Méthode de paiement:
T/T, Western Union, Paypal
Caractéristiques
Erreur préréglée de tension de sortie:
surcharge moins de ±5%,
n a spécifié à un courant de sortie:
100mA
condensateur de sortie:
0.1µF
Ligne maximum règlement:
moins de 0,07% VOUT/V
Règlement de charge maximum:
moins de 0,01% VOUT/mA
Point culminant:

electronics ic chip

,

integrated circuit ic

Introduction

 

Description

Le M24M01-R est un dispositif de mémoire programmable effaçable électriquement (EEPROM) compatible I2C organisé en 128 Ko × 8 bits.Le bus I2C est une interface série à deux fils, comprenant une ligne de données bidirectionnelle et une ligne d'horloge.Les appareils portent un code d'identification de type d'appareil à 4 bits intégré (1010) conformément à la définition du bus I2C.Le M24M01-R se comporte comme un esclave dans le protocole I2C, avec toutes les opérations de mémoire synchronisées par l'horloge série.Les opérations de lecture et d'écriture sont générées par le maître du bus et initiées par une condition de démarrage, suivie du code de sélection de l'appareil, des octets d'adresse et des octets de données.Les transferts de données sont terminés par une condition d'arrêt après un accusé de réception pour l'écriture et après un NoAck pour la lecture.Lors de l'écriture de données dans la mémoire, l'appareil insère un bit d'acquittement pendant le 9e temps bit, après la transmission 8 bits du maître du bus.Lorsque des données sont lues par le maître du bus, le maître du bus accuse réception de l'octet de données de la même manière.Afin de répondre aux exigences environnementales, ST propose le M24M01-R dans des packages ECOPACK®.Les emballages ECOPACK® sont sans plomb et conformes RoHS.ECOPACK est une marque ST.Les spécifications ECOPACK sont disponibles sur : www.st.com.

 

 

Figure 4.

Valeur maximale de Rbus par rapport à la capacité parasite du bus (Cbus) pour un I2C

bus à fréquence maximale fC = 400 kHz

 

Fonctionnement de l'appareil

L'appareil prend en charge le protocole I2C.Ceci est résumé dans la Figure 6. Tout appareil qui envoie des données sur le bus est défini comme étant un émetteur, et tout appareil qui lit les données comme un récepteur.L'appareil qui contrôle le transfert de données est appelé maître du bus et l'autre appareil esclave.Un transfert de données ne peut être lancé que par le maître du bus, qui fournira également l'horloge série pour la synchronisation.Le dispositif M24M01-R est toujours un esclave dans toutes les communications.

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